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Sn4k3ss/WorkingZone

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WorkingZone

Prova finale (Progetto di Reti Logiche) A.A. 2019-2020

Scopo del progetto

Implementare il metodo di codifica a bassa dissipazione di potenza denominata “Working Zone”.

Linguaggio utilizzato per la secrizione del componente: VHDL

FSM

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Built With

Authors

  • Simone Sangeniti - student - Github
  • Massimo Valle - student - Github

About

Prova finale (Progetto di Reti Logiche) 2019

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Contributors 2

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